この資料は、わかり易く書かれたSystemVerilog Class Library (SCL) の仕様書です。
SCLは、UVMと異なり理解し易いアーキテクチャを採用しているので学習時間が多くかかりません。
しかも、SCLは拡張し易い構造になっているので、ユーザ自身によるカスタマイズが可能なパッケージです。
UVMに代わる検証パッケージをお探しの方は、是非ご覧下さい。