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アートグラフィックスはSystemVerilog 設計・検証ツールを提供する EDA ベンダーです。
米国シリコンバレーで永年培った開発技術経験を国産EDAツールの開発に活かしています。


SystemVerilog設計・検証ツール

SystemVerilog言語(IEEE Std 1800-2017)は規格であり、今後長い間使用される言語です。弊社では、SystemVerilog、及び、UVMを正確に、且つ、的確に使用する為の日本語による技術資料も備えています。欧米のベンダーでは成し得ない便宜を図っています。
所在地

〒124-0012 東京都葛飾区立石8-14-1
電話:03-3697-9017
受付:平日は9-18時、土・日・祝日は休
業務案内

EDA全般のソフトウェア設計・開発に関する各種のご依頼を承ります。
SystemVerilog、及び、UVM に関する各種のご依頼(教育資料作成、教育、講演等)も承ります。

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