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SystemVerilogに関する弊社の技術資料を集めたページです。
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SystemVerilogに関する知識習得用資料
| SystemVerilog 雑談 | SystemVerilogに関する話題を気ままに選択して呟いた資料です。 更新日：2024年12月12日 |
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| なぜ SystemVerilog? | 本資料は、これからハードウェア記述言語を学び始める人にとって、Verilogではなく、なぜSystemVerilogなのかを解説します。 更新日：2024年12月5日 |
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| IEEE Std 1800-2023の追加機能 | SystemVerilog言語仕様の改訂版が，2024年2月28日にIEEE Std 1800-2023として公開されました。改訂版には前仕様での誤りの訂正、前仕様で誤解を招いた仕様の補足説明、新規に追加された機能の説明が含まれています。本資料はIEEE
Std 1800-2023に追加された機能を要約しました。 更新日：2024年12月5日 |
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| SystemVerilog 序説 | 本資料は、初学者を対象にしてSystemVerilogがどのような言語であるかを概説しています。これからSystemVerilogを学ぼうとしている方、および、どのようにSystemVerilogを学習すべきか迷っている方にすすめます。 更新日：2024年9月23日 |
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| 初心者の為のSystemVerilog マクロの使い方 | SystemVerilogマクロの使い方を実践的な例を基にして解説した技術資料です。 更新日：2024年2月29日 |
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| SystemVerilog アラカルト | SystemVerilogの持つ特徴的な機能を主観的に選択し解説した技術資料です。 更新日：2022年1月1日 |
講演資料
| UVM の概要と実践に適用する際のガイドライン | UVMの概要、及び、実践で使用する際の留意点を簡単に纏めた資料です。 ET & IoT Technology 2018の講演で使用した資料です。 登録日：2018年11月17日 |
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| SystemVerilog from Zero to One (ダイジェスト版) | SystemVerilogの基礎からUVMの概要までを纏めた資料です。 JEVeC DAY 2018 のチュートリアルで使用しました。 登録日：2018年12月12日 |